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4 p, 404.5 KB Simulador complet d'un processador de codi obert / Casas Brugués, Oriol ; Montón i Macián, Màrius, dir. (Universitat Autònoma de Barcelona. Departament de Microelectrònica i Sistemes Electrònics) ; Universitat Autònoma de Barcelona. Escola d'Enginyeria
Aquest treball implementa un model de UART bàsic com a perifèric sèrie d'un simulador de processador RISC-V. Aquesta relativament moderna arquitectura (ISA) de codi obert representa un canvi de paradigma per al disseny personalitzat de processadors, obrint un ventall de possibilitats per a diverses aplicacions i especificacions. [...]
This work presents a basic UART model as a serial port for a simulation of a RISC-V microcontroller. This relatively new architecture (ISA), which is open-source, represents a paradigm shift towards making custom processor design available to everyone, and also offering an endless array of possibilities for several applications and specifications. [...]
Este trabajo implementa un modelo de UART básico como periférico serie de un simulador de procesador RISC-V. Esta relativamente moderna arquitectura (ISA) de código abierto representa un cambio de paradigma para el diseño personalizado de procesadores, abriendo un abanico de posibilidades para varias aplicaciones y especificaciones. [...]

2021
Enginyeria Informàtica [958]  

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