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13 p, 967.1 KB Implementació del subconjunt d'instruccions C a un processador RISC-V / Tomàs Hidalgo, Maria ; Casanova Mohr, Raimon, dir. (Universitat Autònoma de Barcelona. Departament de Microelectrònica i Sistemes Electrònics) ; Universitat Autònoma de Barcelona. Escola d'Enginyeria
Aquest document detalla el projecte de final de Grau que consisteix a implementar un subconjunt d'instruccions C per a un processador d'arquitectura RISC-V descrit a nivell RTL. Es partirà d'un processador \textit{in-order} prèviament dissenyat amb 5 etapes de pipeline. [...]
This paper contains a bachelor's degree final project that consists on developing a subset of C instructions for a RISC-V architecture processor described at RTL-level. It will be based on a pre-designed processor in-order with 5 pipeline stages. [...]
Este documento detalla el proyecto de fin de Grado que consiste en implementar un subconjunto de instrucciones C para un procesador de arquitectura RISC-V descrito a nivel RTL. Se partirá de un procesador in-order previamente diseñado con 5 etapas de pipeline. [...]
2022
Enginyeria Informàtica [958]  
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